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#1 Le 10/06/2025, à 14:03
- ptilou007
vhdl ? exemple ?
bonjour,
je me demande qui a des exemples de codes avec ce langage ?
de preference, mais je prends tous sur les architecture « friend » libre, puisque le materiel ne l’est pas …
pour les curieux je n’ai rien trouve, (en exemple de code), mais cela :
https://connect.ed-diamond.com/GNU-Linu … -debutants
philippe
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#2 Le 10/06/2025, à 14:15
- xubu1957
Re : vhdl ? exemple ?
Bonjour,
Ce machin > wikipedia.org/wiki/VHDL ?
Conseils pour les nouveaux demandeurs et pas qu'eux
Important : Pensez à passer vos sujets en [Réso|u] lorsque ceux-ci le sont, au début du titre en cliquant sur Modifier sous le premier message, et un bref récapitulatif de la solution à la fin de celui-ci. Merci. Membre de Linux-Azur
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#3 Le 10/06/2025, à 19:34
- Nuliel
Re : vhdl ? exemple ?
Bonjour,
Le VHDL c'est pas un langage de programmation mais ça permet de décrire du matériel.
Un exemple d'une implémentation UART : https://nandland.com/uart-serial-port-module/
Si tu cherches un FPGA, tu peux regarder chez Lattice pour les ice40, il y a une certaine compatibilité avec des soft open source comme apio. Ça supporte le verilog, mais le vhdl il faut des plugins je pense.
Un tuto: https://www.youtube.com/watch?v=lLg1AgA … NmQ_9CIKhb
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#4 Le 11/06/2025, à 14:14
- RaphaelG
Re : vhdl ? exemple ?
Pourrait on dire que c'est un markup language ?
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#5 Le 11/06/2025, à 20:16
- Nuliel
Re : vhdl ? exemple ?
Pourrait on dire que c'est un markup language ?
Pour moi markup language = html/css, c'est assez différent.
On ne va pas dire où placer les différents blocs, le synthétiseur s'en débrouille (il gère un problème très difficile, les contraintes timing, pour que les données arrivent et partent des différents blocs aux bons moments)
Ce n'est vraiment pas comme du C/python/... où on a une suite séquentielle d'instructions, là c'est en parallèle: on pense registre, timing, portes logiques, ...
Pour donner un exemple très simple: un CPU a une liste d'instructions qu'il sait gérer (il sait donc faire des opérations mathématiques, bouger des données), le FPGA sait pas faire une addition, le synthétiseur créera un bloc pour ça si besoin (bloc qui ne sera pas partagé, c'est pas juste une instruction qui est implémentée)
Dernière modification par Nuliel (Le 11/06/2025, à 20:19)
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